#@ # #@ # Running icc_shell Version D-2010.03-ICC-SP1 for linux -- Apr 10, 2010 #@ # Date: %sTue Nov 2 10:21:05 2010 #@ # Run by: mark@soc2.ece.utexas.edu #@ gui_start source or1200_alu_route.tcl #@ # MAKE THIS MATCH YOUR TOP-LEVEL MODULE #@ set BLOCK "or1200_alu" #@ #@ # define either NETLIST or DDC. DDC is used if both are defined #@ #set DDC "/home/projects/courses/spring_10/ee382m-16800/project_spring10/syn/pnr/${BLOCK}_struct.ddc" #@ set NETLIST "/scratch/mark/ICC/${BLOCK}.gate.v" #@ #@ #set MW_REF_LIBS { #@ # "/scratch/global_pnr/cpu/ref_milkyway/art_hssp_2048x32.mw" #@ # "/scratch/global_pnr/cpu/ref_milkyway/art_hssp_512x20.mw" #@ #} #@ #set MW_LINK_LIBS { #@ # "/scratch/global_pnr/cpu/link_libs/art_hssp_2048x32.db" #@ # "/scratch/global_pnr/cpu/link_libs/art_hssp_512x20.db" #@ #} #@ #@ #define either WIDTH and HEIGHT or ASPECT_RATIO and UTILIZATION #@ # WIDTH and HEIGHT is used if both are defined #@ #set WIDTH 180 #@ #set HEIGHT 268 #@ set WIDTH 200 #@ set HEIGHT 300 #@ #set ASPECT_RATIO 1.5 #@ #set UTILIZATION 0.6 #@ #@ # set this to "high" at your own risk - it has caused icc_shell to dump core on some blocks #@ set PLACE_EFFORT medium #@ #@ # instance-specific placement options #@ #set FIXED_PLACEMENT { #@ # { "or1200_ic_ram/ic_ram0/artisan_ssp" #@ # { #@ # {is_fixed true} #@ # {origin {120 120}} #@ # } #@ # } #@ # { "or1200_ic_tag/ic_tag0/artisan_ssp" #@ # { #@ # {is_fixed true} #@ # {origin {200 980}} #@ # } #@ # } #@ #} #@ #@ #@ # vars from here down are optional, but recommended #@ set ATRAT "/home/projects/courses/fall_10/ee382m-16947/OLD_PROJECTS/project_spring10/atrat/r6/${BLOCK}.atrat" #@ set PIN_CONSTRAINTS "/scratch/mark/ICC/pnr/${BLOCK}.tdf" #@ #set TIMING_WEIGHT <1-7> #@ set TIMING_WEIGHT 1 #@ #set CONGESTION_WEIGHT <1-12> #@ set CONGESTION_WEIGHT 1 #@ #set TRACK_TIMING_WEIGHT <1-10> #@ set TRACK_TIMING_WEIGHT 1 #@ #@ # these vars are unused, but may be used in the future #@ set IO_MARGIN_TOP 1.14 #@ set IO_MARGIN_BOTTOM 1.14 #@ set IO_MARGIN_LEFT 0.9 #@ set IO_MARGIN_RIGHT 0.9 #@ #@ set LEFT_IO2CORE 0.638 #@ set BOTTOM_IO2CORE 0.638 #@ set RIGHT_IO2CORE 0.638 #@ set TOP_IO2CORE 0.87 #@ #@ #source /scratch/mark/ICC/route_action.tcl #@ # -- End source or1200_alu_route.tcl source route_action.tcl #@ if {[info exists BLOCK] == 0} { #@ puts "ERROR: you should not invoke this script directly. Please make a copy of icc_block_script.tcl that is customized for your block and invoke that" #@ quit #@ } #@ #@ sh echo block = $BLOCK > current #@ #@ if {[info exists WIDTH] == 0} { #@ puts "ERROR: ASPECT_RATIO and UTILIZATION based routing are no longer supported. Please explicitly give WIDTH and HEIGHT parameters" #@ } #@ #@ if {[info exists TOP_LEVEL_ROUTE] == 0} { #@ set TOP_LEVEL_ROUTE 0 #@ } #@ if {[info exists CLK_NET] == 0} { #@ set CLK_NET clk #@ } #@ #@ #@ set search_path ". /usr/local/packages/synopsys_2009/syn/libraries/syn /home/projects/courses/fall_10/ee382m-16947/Artisan/synopsys /home/projects/courses/fall_10/ee382m-16947/Artisan/symbols/synopsys" #@ #@ if {[info exists WORKING_DIR] == 0} { #@ set WORKING_DIR "/scratch/mark/ICC/cpu/blocks/${BLOCK}" #@ } #@ if {[file exists $WORKING_DIR] == 0} { sh mkdir $WORKING_DIR } #@ sh chmod -R 777 $WORKING_DIR #@ set ORIG_DIR [pwd] #@ cd $WORKING_DIR #@ #@ set CONSTRAINTS_GENERATOR "/home/projects/courses/fall_10/ee382m-16947/project_spring10/scripts/scripts_for_blocks/genConstraints.pl" #@ set CLOCK_PERIOD 4 #@ set CLOCK_SCALE_FACTOR 0.9 #@ set SDC_FILE "/scratch/mark/ICC/${BLOCK}.sdc" #@ set PIN_CONSTRAINTS_2010 "/scratch/mark/ICC/${BLOCK}.pin.tcl" #@ #@ set target_library "typical.db" #@ set link_library "* typical.db" #@ if {[info exists MW_LINK_LIBS]} { #@ foreach linklib $MW_LINK_LIBS { #@ # set target_library "$target_library $linklib"; #@ set link_library "$link_library $linklib" #@ } #@ } #@ #@ set ::mw_design_library "./${BLOCK}.mw" #@ #@ set mw_logic0_net "VSS" #@ set mw_logic1_net "VDD" #@ #@ set ::mw_cel_without_fram_tech "false" #@ #@ set ::tf_file "/home/projects/courses/fall_10/ee382m-16947/Artisan/sc/apollo/tf/tsmc18_6lm.tf" #@ #set ::tf_file "/scratch/global_pnr/tsmc18_6lm.tf" #@ #@ set ::mw_ref_lib "/home/projects/courses/fall_10/ee382m-16947/Artisan/sc/apollo/tsmc18" #@ if {[info exists MW_REF_LIBS]} { #@ foreach reflib $MW_REF_LIBS { #@ set ::mw_ref_lib "${::mw_ref_lib} $reflib" #@ } #@ } #@ #@ #@ proc update_pg {} { #@ echo "next: update_pg" #@ # connect_pg_nets -nets {VDD} -ports VDD -net_type power #@ # connect_pg_nets -nets {VSS} -ports VSS -net_type ground #@ derive_pg_connection -power_net VDD -ground_net VSS -reconnect #@ # derive_pg_connection -reconnect #@ } #@ #@ puts "mw_ref_lib is ${::mw_ref_lib}" #@ puts "target_library is $target_library" #@ puts "link_library is $link_library" #@ #@ # save last routing library #@ if {[file exists ${::mw_design_library}.old]} { sh rm -fr ${::mw_design_library}.old } #@ if {[file exists $::mw_design_library]} { sh mv $::mw_design_library ${::mw_design_library}.old } #@ #@ puts "creating milkyway lib" #@ create_mw_lib -technology "$::tf_file" -open "$::mw_design_library" -mw_reference_library "$::mw_ref_lib" #@ #@ set_tlu_plus_files -max_tluplus /scratch/mark/ICC/starXT_018_6m.tlup -tech2itf_map /scratch/mark/ICC/starXT_018_6m.map #@ check_tlu_plus_files #@ #@ if {[info exists SUBBLOCK_NETLISTS]} { #@ foreach netlist ${SUBBLOCK_NETLISTS} { #@ read_verilog ${netlist} #@ } #@ } #@ if {[info exists SUBBLOCK_DDCS]} { #@ foreach ddc ${SUBBLOCK_DDCS} { #@ read_ddc ${ddc} #@ } #@ } #@ #@ set DESIGN_LOADED 0 #@ if {([info exists DDC]) && ([file exists $DDC])} { read_ddc $DDC; set DESIGN_LOADED 1 } #@ if {($DESIGN_LOADED == 0) && ([info exists NETLIST]) && ([file exists $NETLIST])} { read_verilog $NETLIST; set DESIGN_LOADED 1 } #@ win_set_filter -class cell -filter {cell_array } #@ win_set_filter -class placement_blockage -filter {wiring } -layer {} #@ win_set_filter -expand_cell_types {std io hard_macro soft_macro ilm other } #@ win_set_select_class {cell port plan_group edit_group shape via placement_blockage } #@ if {$DESIGN_LOADED == 0} { puts "Error! Must specify either DDC or NETLIST file"; puts "NETLIST is $NETLIST"; exit } #@ #@ list_designs #@ current_design $BLOCK #@ uniquify #@ link #@ #@ if {[info exists STOP_AFTER_LINK] == 1} { #@ save_mw_cel -as ${BLOCK}_link #@ close_mw_lib #@ sh chmod -R 777 $::mw_design_library #@ quit #@ } #@ #@ #@ # modify the following to suit your design #@ # right now we're just going to use a very simple rectangular floorplan #@ set ROUTE_OPTIONS_SET 0 #@ #@ #if {($ROUTE_OPTIONS_SET == 0) && ([info exists WIDTH]) && ([info exists HEIGHT])} { initialize_floorplan -control_type width_and_height -core_width $WIDTH -core_height $HEIGHT; set ROUTE_OPTIONS_SET 1 } #@ #@ #if {($ROUTE_OPTIONS_SET == 0) && ([info exists WIDTH]) && ([info exists HEIGHT])} { initialize_floorplan -control_type width_and_height -core_width $WIDTH -core_height $HEIGHT -left_io2core 4 -bottom_io2core 4 -right_io2core 4 -top_io2core 4; set ROUTE_OPTIONS_SET 1 } #@ #@ if {($ROUTE_OPTIONS_SET == 0) && ([info exists WIDTH]) && ([info exists HEIGHT])} { initialize_floorplan -control_type width_and_height -core_width $WIDTH -core_height $HEIGHT -bottom_io2core 1 -top_io2core 1 -right_io2core 1 -left_io2core 1; set ROUTE_OPTIONS_SET 1 } #@ #@ update_pg #@ #@ #@ #@ echo "next: read_pin_pad_physical_constraints" #@ if {${TOP_LEVEL_ROUTE} == 0} { #@ # define pin side and position #@ if {([info exists PIN_CONSTRAINTS_2010]) && ([file exists ${PIN_CONSTRAINTS_2010}])} { #@ read_pin_pad_physical_constraints ${PIN_CONSTRAINTS_2010} #@ } #@ } #@ # ------------------------------ #@ # LEFT #@ # ------------------------------ #@ set_pin_physical_constraints -pin_name {a[0]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 1 #@ set_pin_physical_constraints -pin_name {b[0]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 2 #@ #@ set_pin_physical_constraints -pin_name {a[1]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 3 #@ set_pin_physical_constraints -pin_name {b[1]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 4 #@ #@ set_pin_physical_constraints -pin_name {a[2]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 5 #@ set_pin_physical_constraints -pin_name {b[2]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 6 #@ #@ set_pin_physical_constraints -pin_name {a[3]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 7 #@ set_pin_physical_constraints -pin_name {b[3]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 8 #@ #@ set_pin_physical_constraints -pin_name {a[4]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 9 #@ set_pin_physical_constraints -pin_name {b[4]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 10 #@ #@ set_pin_physical_constraints -pin_name {a[5]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 11 #@ set_pin_physical_constraints -pin_name {b[5]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 12 #@ #@ set_pin_physical_constraints -pin_name {a[6]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 13 #@ set_pin_physical_constraints -pin_name {b[6]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 14 #@ #@ set_pin_physical_constraints -pin_name {a[7]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 15 #@ set_pin_physical_constraints -pin_name {b[7]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 16 #@ #@ set_pin_physical_constraints -pin_name {b[8]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 17 #@ set_pin_physical_constraints -pin_name {a[8]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 18 #@ #@ set_pin_physical_constraints -pin_name {a[9]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 19 #@ set_pin_physical_constraints -pin_name {b[9]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 20 #@ #@ set_pin_physical_constraints -pin_name {a[10]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 21 #@ set_pin_physical_constraints -pin_name {b[10]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 22 #@ #@ set_pin_physical_constraints -pin_name {a[11]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 23 #@ set_pin_physical_constraints -pin_name {b[11]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 24 #@ #@ set_pin_physical_constraints -pin_name {a[12]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 25 #@ set_pin_physical_constraints -pin_name {b[12]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 26 #@ #@ set_pin_physical_constraints -pin_name {a[13]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 27 #@ set_pin_physical_constraints -pin_name {b[13]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 28 #@ #@ set_pin_physical_constraints -pin_name {a[14]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 29 #@ set_pin_physical_constraints -pin_name {b[14]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 30 #@ #@ set_pin_physical_constraints -pin_name {a[15]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 31 #@ set_pin_physical_constraints -pin_name {b[15]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 32 #@ #@ set_pin_physical_constraints -pin_name {a[16]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 33 #@ set_pin_physical_constraints -pin_name {b[16]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 34 #@ #@ set_pin_physical_constraints -pin_name {a[17]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 35 #@ set_pin_physical_constraints -pin_name {b[17]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 36 #@ #@ set_pin_physical_constraints -pin_name {a[18]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 37 #@ set_pin_physical_constraints -pin_name {b[18]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 38 #@ #@ set_pin_physical_constraints -pin_name {a[19]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 39 #@ set_pin_physical_constraints -pin_name {b[19]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 40 #@ #@ set_pin_physical_constraints -pin_name {a[20]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 41 #@ set_pin_physical_constraints -pin_name {b[20]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 42 #@ #@ set_pin_physical_constraints -pin_name {a[21]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 43 #@ set_pin_physical_constraints -pin_name {b[21]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 44 #@ #@ set_pin_physical_constraints -pin_name {a[22]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 45 #@ set_pin_physical_constraints -pin_name {b[22]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 46 #@ #@ set_pin_physical_constraints -pin_name {a[23]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 47 #@ set_pin_physical_constraints -pin_name {b[23]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 48 #@ #@ set_pin_physical_constraints -pin_name {a[24]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 49 #@ set_pin_physical_constraints -pin_name {b[24]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 50 #@ #@ set_pin_physical_constraints -pin_name {a[25]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 51 #@ set_pin_physical_constraints -pin_name {b[25]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 52 #@ #@ set_pin_physical_constraints -pin_name {a[26]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 53 #@ set_pin_physical_constraints -pin_name {b[26]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 54 #@ #@ set_pin_physical_constraints -pin_name {a[27]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 55 #@ set_pin_physical_constraints -pin_name {b[27]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 56 #@ #@ set_pin_physical_constraints -pin_name {a[28]} -layers {metal3 } -width 0.28 -depth 0.28 -side 1 -order 57 #@ set_pin_physical_constraints -pin_name {b[28]} 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set_pin_physical_constraints -pin_name {cust5_op[4]} -layers {metal4 } -width 0.28 -depth 0.28 -side 2 -order 11 #@ set_pin_physical_constraints -pin_name {cust5_limm[0]} -layers {metal4 } -width 0.28 -depth 0.28 -side 2 -order 12 #@ set_pin_physical_constraints -pin_name {cust5_limm[1]} -layers {metal4 } -width 0.28 -depth 0.28 -side 2 -order 13 #@ set_pin_physical_constraints -pin_name {cust5_limm[2]} -layers {metal4 } -width 0.28 -depth 0.28 -side 2 -order 14 #@ set_pin_physical_constraints -pin_name {cust5_limm[3]} -layers {metal4 } -width 0.28 -depth 0.28 -side 2 -order 15 #@ set_pin_physical_constraints -pin_name {cust5_limm[4]} -layers {metal4 } -width 0.28 -depth 0.28 -side 2 -order 16 #@ set_pin_physical_constraints -pin_name {cust5_limm[5]} -layers {metal4 } -width 0.28 -depth 0.28 -side 2 -order 17 #@ set_pin_physical_constraints -pin_name {macrc_op} -layers {metal4 } -width 0.28 -depth 0.28 -side 2 -order 65 #@ set_pin_physical_constraints -pin_name {alu_op[0]} -layers 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